在本项目中，我们将研究如何使用 HLS 构建 Sobel 边缘检测 IP 核，然后将其包含在我们选择的 Xilinx FPGA 中。
FPGA正在经历一场迟来的革命，但90%的工程师还在用20年前的老方法硬扛！ 这玩意儿明明能像乐高一样灵活拼装硬件，却因为开发工具太反人类，硬生生把自己活成了小众技术。
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